[過去ﾛｸﾞ] (情報科学)技術的特異点と科学技術等 2 (ナノテク)©2ch.net (319ﾚｽ)
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239(1): >>238 2018/07/30(月) 06:55:38 ID:wOzVCFyH(23/50)調 AAS

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オンチップキャッシュ

　　level　　Size(B)　　Chip Total(B)　　Way　　Entry　　Line 長(B)　　接続
データキャッシュ
　　L1　　2K　　1M　　8　　4　　64　　2PEに1つ
　　L2　　64k　　4M　　8　　32　　256　　Ciry毎 L1 8 個に対して
　　L3　　2M　　8M　　8　　256　　1k　　Prefecture毎 L2 16 個に対して
命令キャッシュ
　　L1　　2K　　2M　　8　　2　　128　　PE毎
　　L2　　32K　　2M　　4　　32　　256　　City毎 PE 16個
　　L3　　128K　　512K　　4　　32　　1K　　Prefecture毎 L2 16 個

複数PE間のメモリコンシステンシはソフトウェア責任、 PE毎に16KBのローカルメモリを備える

Page 17

プログラミング概要

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